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频率合成器简介

日期： 2019-11-14
浏览次数: 8

      频率合成技术起源于20世纪30年代，至今已有70多年的历史。


     频率合成器是利用一个或多个基准频率，通过各种技术途径产生一系列的离散频率信号的设备。这些频率的稳定度和精度均和基准频率相同，而且频率的转换时间很短，这样才会有效率和实用价值。


　　频率合成器的实现方法有3种：直接模拟频率合成、间接频率合成和直接数字频率合成。


　   频率合成器作用是给微波扫频信号提供一定分辨力的频率参考信号，并对微波信号输出频率进行逐点锁定，以得到高准确度和稳定度的扫频输出信号。输出点频信号和扫频信号是微波合成扫源的基本功能，而点频输出又是扫频输出的基础（扫频信号的输出可以利用点频通过程序控制的方法实现）。


　　频率合成源是微波系统的重要功能单元，在收发信机、雷达探测、通信、检测仪器等电子设备中被广泛使用。


       （以上内容整理自网络，如有侵权请联系删除！）
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    分频器通常用来对某个给定的时钟频率进行分频，以得到所需的时钟频率。在设计数字电路中会经常用到多种不同频率的时钟脉冲，一般采用由一个固定的晶振时钟频率来产生所需要的不同频率的时钟脉冲的方法进行时钟分频。      在FPGA的设计中分频器是使用频率较高的基本设计，在很多的设计中也会经常用到芯片集成的锁相环资源，如用Xilinx的DLL以及Altera的PLL来进行时钟的分频、倍频与相移。在一些对时钟精度不高的场合，会经常利用硬件描述语言来对时钟源进行时钟分频。       分频器是一种基本电路，一般包括数字分频器、模拟分频器和射频分频器。根据不同设计的需要，有时还会要求等占空比。数字分频器采用的是计数器的原理，权值为分频系数。模拟分频器就是一个频率分配器，用带阻带通实现(比如音箱上高中低喇叭的分配器)。射频分频器也是滤波器原理，用带内外衰减，阻抗匹配实现。       随着FPGA技术的发展，基于FPGA技术的硬件设计数字分频器已成为数字系统设计的研究重点。数字分频器通常分为整数分频器和小数分频器。在有些需求下还要分数分频器。      本设计是基于FPGA的数字分频器，通过VHDL硬件设计语言，在Modelsim6.5上对设计的分频器进行仿真验证。       数字分频器的设计       数字分频器的设计与模拟分频器的设计不同，数字分频器可以使用触发器设计电路对时钟脉冲进行时钟分频。分频器的一个重要指标就是占空比，即在一个周期中高电平脉冲在整个周期中所占的比例。占空比一般会有1:1,1: N等不同比例的要求,由于占空比的比例要求不一样，所以采用的...
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